MAX11634–MAX11637
12-Bit, 300ksps ADCs with Differential
Track/Hold, and Internal Reference
_______________________________________________________________________________________
5
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Externally clocked conversion
208
SCLK Clock Period
tCP
Data I/O
100
ns
SCLK Pulse-Width High
tCH
40
ns
SCLK Pulse-Width Low
tCL
40
ns
SCLK Fall to DOUT Transition
tDOT
CLOAD = 30pF
40
ns
CS Rise to DOUT Disable
tDOD
CLOAD = 30pF
40
ns
CS Fall to DOUT Enable
tDOE
CLOAD = 30pF
40
ns
DIN to SCLK Rise Setup
tDS
40
ns
SCLK Rise to DIN Hold
tDH
0
ns
CS Low to SCLK Setup
tCSS0
40
ns
CS High to SCLK Setup
tCSS1
40
ns
CS High After SCLK Hold
tCSH1
0
ns
CS Low After SCLK Hold
tCSH0
0
4
s
tCSPW
CKSEL = 00
40
ns
CNVST Pulse-Width Low
CKSEL = 01
1.4
s
Voltage conversion
7
CS or CNVST Rise to EOC
Low (Note 11)
Reference power-up
65
s
TIMING CHARACTERISTICS (Figure 1)
Note 11: This time is defined as the number of clock cycles needed for conversion multiplied by the clock period. If the internal
reference needs to be powered up, the total time is additive. The internal reference is always used for temperature
measurements.
Typical Operating Characteristics
(VDD = 3V, VREF = 2.5V, fSCLK = 4.8MHz, CLOAD = 30pF, TA = +25°C for MAX11635/MAX11637, unless otherwise noted. VDD = 5V,
VREF = 4.096V, fSCLK = 4.8MHz, CLOAD = 30pF, TA = +25°C for MAX11634/MAX11636, unless otherwise noted.)
INTEGRAL NONLINEARITY
vs. OUTPUT CODE
MAX11634
toc01
OUTPUT CODE (DECIMAL)
INL
(LSB)
3072
2048
1024
-0.8
-0.6
-0.4
-0.2
0
0.2
0.4
0.6
0.8
1.0
-1.0
04096
MAX11634/MAX11636
fSAMPLE = 300ksps
INTEGRAL NONLINEARITY
vs. OUTPUT CODE
MAX11634
toc02
OUTPUT CODE (DECIMAL)
INL
(LSB)
3072
2048
1024
-0.8
-0.6
-0.4
-0.2
0
0.2
0.4
0.6
0.8
1.0
-1.0
04096
MAX11635/MAX11637
fSAMPLE = 300ksps
DIFFERENTIAL NONLINEARITY
vs. OUTPUT CODE
MAX11634
toc03
OUTPUT CODE (DECIMAL)
DNL
(LSB)
3072
2048
1024
-0.8
-0.6
-0.4
-0.2
0
0.2
0.4
0.6
0.8
1.0
-1.0
0
4096
MAX11634/MAX11636
fSAMPLE = 300ksps
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